歷史記錄,不是用來銘記的,而是用來打破的。
60年前一個美國人隨手畫了條曲線,全球芯片產業圍著它轉了半個多世紀。如今這條曲線終于畫不動了,接棒的中國人站了出來。這不是一個定律取代另一個定律,是一個時代取代另一個時代。
10年后,他將這個預測修正為“每兩年翻一番”,從此這個被后人稱為“摩爾定律”的觀察,成了全球半導體行業半個多世紀的“圣經”。
戈登·摩爾在1965年畫下那條神奇的指數曲線時,或許沒想到它會引領世界這么久,也沒想到終結它的,不是另一個美國人,而是一家中國公司提出的全新框架。
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1965年的春天,摩爾那時的雇主還是仙童半導體公司,這家公司后來孵化出了英特爾、AMD等一堆硅谷巨頭。摩爾并不是什么高高在上的理論物理學家,他只是一個善于觀察的工程師。
到了1975年,摩爾將“每年翻一番”修正為“每兩年翻一番”。此后全球半導體產業就像被上了發條一樣,按照這個節拍狂奔。
從1971年全世界第一塊單芯片微處理器擁有2300個晶體管,到20世紀80年代初增至10萬個,90年代初突破1000萬個。2019年,一塊芯片上可容納的晶體管總數已經超過了100億個。
2納米、1.8納米……摩爾定律帶領人類走過了五次計算革命。英特爾按照它建晶圓廠,臺積電按照它投EUV光刻機,ASML按照它花20年開發最頂尖的極紫外光刻設備。它不僅是技術觀察,更是一份“全球行業契約”——所有人都按這個節奏投入,那么預言就會自我實現。
但半個多世紀過去,這把“量尺”終于走到頭了。
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二、量子隧穿與10億美元成本:摩爾定律撞上了物理和經濟的“雙重高墻”
為什么摩爾定律跑不動了?原因就兩個:物理極限和經濟墻。
先看物理墻。當制程工藝從微米級下探到納米級,晶體管小到一定程度后,電子不再老老實實沿著導線跑,而是出現了“量子隧穿效應”——電子直接穿墻而過。
物理學家測算過,量子隧穿的物理臨界點約為1.5納米。當兩個晶體管之間的絕緣層小于1.5納米時,電子會大規模穿墻,芯片內部漏電導致直接報廢。
說白了,物理規律告訴所有人:這條路,你卷不動了。
再看經濟墻。一顆2納米芯片的設計預算已經突破10億美元。一臺EUV光刻機售價突破1.5億美元,建一條3nm芯片生產線建廠成本動輒近200億美元起步,全球能投產的工廠只剩兩三家。
半導體歷史上首次出現了“單晶體管成本反轉”——做得越先進,反而越昂貴。行業分析師詹姆斯·麥肯齊直言:“摩爾定律的延續正變得日益困難,且成本不斷攀升。”
這就是何庭波說的那堵“墻”。她曾在采訪中坦言:摩爾定律演進以后,2005年就開始式微了,基本上再走10年就會遇到非常重的物理邊界的“墻”,華為公司先遇到了這個“墻”。
西方靠制程封鎖中國,以為卡住光刻機和高端芯片就等于掐住了中國半導體的喉嚨。他們以為中國人只能永遠跟在后面卷尺寸。
但他們算錯了一件事:當一條路被堵死,中國人會直接另開一條高速公路。
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三、華為“韜定律”拆墻:不卷尺寸卷時間,中國人開始寫游戲規則了
“韜(τ)定律”到底是個啥?你不必看懂復雜的物理公式,記住一個核心就行:摩爾定律玩的是“幾何縮微”——把晶體管越做越小;華為玩的是“時間縮微”——把信號傳輸時間越壓越短。
τ是物理學里的時間常數,信號在芯片里跑一圈要花的時間。τ越小,芯片跑得越快。
那怎么才能讓信號跑得更快呢?核心黑科技叫“邏輯折疊”。傳統芯片像一張平鋪的地圖,信號從A到B要繞很遠;邏輯折疊就像把地圖的一部分“折疊”到樓上,把電路從“一層樓”變成“多層樓”,信號傳輸路徑從“遠距離通勤”變成了“樓上樓下直達”。
何庭波自己打了個比方:傳統的芯片像一座攤開的平面城市,信號要穿過不同功能區得七拐八繞;邏輯折疊相當于把平房改成立體城市,區域之間安裝了數百萬臺“電梯”,過去隔了幾條街的兩個單元現在樓上樓下,信號一抬腳就能直達。
這不只是理論。過去六年,華為基于這個思路已經量產出貨了381款芯片。今年秋季的新麒麟手機芯片將是第一款完整采用邏輯折疊技術的消費級芯片。2031年的目標是——晶體管密度達到傳統1.4納米制程的同等水平。
何庭波說過一句話,值得刻在芯片史冊上:“摩爾定律不是為了‘幾何縮微’,它的本質是要有更快更多的功能。既然在‘幾何縮微’上遇到這么大的困難,那就用‘時間縮微’來衡量電子學的進步。”
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今天,“韜定律”不是跟誰搶飯碗,而是告訴全世界:半導體演進的路,不只有一條。當西方那條路走進了死胡同,中國已經把新路鋪到了你腳下。
從今天起,芯片世界多了一把“中國尺子”。
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